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產業動態 DTV/TV影像FPGA設計與實作- 以 TV Box (電視盒) ASIC 為實作專題
台大慶齡工業中心 本新聞稿發佈於2006/07/21,由發布之企業承擔內容之立場與責任,與本站無關

電視訊號介紹. • TV DECODER原理與實際元件介紹. • I2C 原理與電路設計. • ITU656 YUV 4:2:2 原理與解碼電路設計. • 基本De_interlace原理與電路設計. • VGA規範與VGA timming電路設計. • MEMORY在Video上的應用與 Memory controller設計. • 影像縮放 Scaler 及 Frame Buffer 設計專題實作(學員需實作出一部 TV Box (以學員自己設計之SOC運作)

 
■ 發布/輪播新聞稿 新聞稿直達14萬電子報訂戶刊登新聞稿:按此
 
開課日期 2006/9/3
結束日期 2006/10/1
上課時間 本課程
【第一梯次】:【7/30開課,已額滿】
7/30, 8/6, 8/13, 8/20, 8/27, (6hr/每週日),合計30hr
【第二梯次】:【9/3開課,招生中】
9/3、9/10、9/17、9/24、10/1(6hr/每週日),合計30hr
上課地點 台大慶齡中心研討室

課程主旨 將業界常用之 TV/DTV 影像處理ASIC之設計公開並實作, 替業界培訓可立刻上手之DTV/多媒體視訊方面之IC設計工程師.本課程公開所有 Verilog code. 此課為業界從所未有, 以最開放之 Open Core 胸襟, 將多年累積之IP智財, 免費開放給學員學習。
課程簡介
課程內容 • 電視訊號介紹. • TV DECODER原理與實際元件介紹. • I2C 原理與電路設計. • ITU656 YUV 4:2:2 原理與解碼電路設計. • 基本De_interlace原理與電路設計. • VGA規範與VGA timming電路設計. • MEMORY在Video上的應用與 Memory controller設計. • 影像縮放 Scaler 及 Frame Buffer 設計專題實作(學員需實作出一部 TV Box (以學員自己設計之SOC運作)
師資介紹 友晶科技工程師→楊至信先生

參加對象 電視產品之設計軟硬體工程師、電視控制IC設計人員(演算法,FPGA)、 有志從事數位電視產業之人員、其他與數位電視實務相關之晶片系統產業、系統廠商、從事與半導體產業相關工作者、資訊家電或網路設備領域之開發工程師等在職人員。
課程費用 總計12,000元;補助6,000元;學員自付新台幣 6,000元
報名方式 ►.線上報名:台大嚴慶齡工業研究中心http://www.tl.ntu.edu.tw/點選課程名稱

報名專線 02-23628136 及 02-23693661 轉分機 44
注意事項 ★請收到【繳費通知】時,繳清費用來確認參訓否。
★請多利用網路線上報名。
★付款方式
一、支/匯票
抬頭:國立台灣大學嚴慶齡工業發展基金會合設工業研究中心
寄至:106台北市基隆路三段130號
台大嚴慶齡工業研究中心 葉小姐收
電話:02-23628136#44
二、匯款/銀行轉帳
銀行:華南銀行台大分行(銀行代碼008)
帳號:線上報名後完成後自動產生之帳號

【課程進行期間,因老師出國開會、或逢連休假日或遇颱風等,本中心將依情況適時調整並公告】

- 新聞稿有效日期,至2006/08/21為止


聯絡人 :葉小姐
聯絡電話:02-23628136 轉分機 44
電子郵件:lcyeh@tl.ntu.edu.tw

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